［加州圣荷塞及中國上海，2006年9月7日］Cadence 設(shè)計(jì)系統(tǒng)公司與中芯國際集成電路制造有限公司（SMIC）今天宣布，兩家公司已經(jīng)聯(lián)合開發(fā)出低功耗數(shù)字設(shè)計(jì)參考流程，支持SMIC先進(jìn)的90納米工藝技術(shù)。該設(shè)計(jì)參考流程包含對Cadence® Encounter®時序系統(tǒng)的支持，以滿足設(shè)計(jì)師為計(jì)算機(jī)、消費(fèi)電子、網(wǎng)絡(luò)及無線產(chǎn)品市場開發(fā)集成電路越來越高的需求。
該設(shè)計(jì)參考流程結(jié)合了Cadence Encounter數(shù)字IC設(shè)計(jì)平臺和Cadence可制造性設(shè)計(jì)(DFM）技術(shù)，攻克了低功耗、復(fù)雜的層次設(shè)計(jì)、時序及信號集成（SI）簽收等納米設(shè)計(jì)的挑戰(zhàn)。該設(shè)計(jì)參考流程使用SMIC的90納米工藝技術(shù)進(jìn)行開發(fā)，通過了樣品設(shè)計(jì)驗(yàn)證。Cadence作為最早與SMIC合作的電子設(shè)計(jì)自動化公司之一，與SMIC一起推出了90納米Encounter低功耗系統(tǒng)級芯片設(shè)計(jì)參考流程。Cadence的新技術(shù)如Encounter時序系統(tǒng)已結(jié)合到該流程中，用于靜態(tài)時序分析（STA）簽收。
“與Cadence的合作幫助我們達(dá)成繼續(xù)推動中國和全球半導(dǎo)體市場發(fā)展的目標(biāo)。”SMIC設(shè)計(jì)服務(wù)部副總裁歐陽雄說，“作為復(fù)雜低功耗及數(shù)字設(shè)計(jì)解決方案的領(lǐng)導(dǎo)者，Cadence提供了獨(dú)特的技術(shù)與專業(yè)知識，設(shè)計(jì)了這一參考設(shè)計(jì)流程。這一90納米SMIC低功耗參考設(shè)計(jì)流程，有Encounter時序系統(tǒng)及其它來自Cadence的尖端數(shù)字IC設(shè)計(jì)技術(shù)推動，加上SMIC的工藝技術(shù)，將確保我們的客戶獲得極高的質(zhì)量和生產(chǎn)力，并提供了更快、更有效、風(fēng)險更低的投片方式。”
這套“SMIC-Cadence設(shè)計(jì)參考流程”是一套完整的Encounter低功耗系統(tǒng)級芯片設(shè)計(jì)參考流程，其重點(diǎn)在于90納米系統(tǒng)級芯片（SoC）的高效能源利用。它對功耗問題的優(yōu)化貫穿了所有必要的設(shè)計(jì)步驟，包括邏輯綜合、模擬、測試設(shè)計(jì)、等價性檢驗(yàn)、芯片虛擬原型、物理實(shí)現(xiàn)和完成簽收分析。Encounter低功耗流程是業(yè)界首個為現(xiàn)代系統(tǒng)級芯片節(jié)能需求而設(shè)計(jì)的完整的低功耗解決方案之一。設(shè)計(jì)、實(shí)現(xiàn)和驗(yàn)證技術(shù)完整結(jié)合，讓設(shè)計(jì)師的工作效率大大提升。該設(shè)計(jì)參考流程采用了Cadence Encounter以連線為首要考量的連續(xù)收斂方法，讓設(shè)計(jì)師可以迅速得到可行的網(wǎng)表和虛擬原型，在設(shè)計(jì)周期的初期就可以分析及優(yōu)化功耗、時序、SI和布線。
此外，該流程為設(shè)計(jì)師提供了一個全面的平臺，強(qiáng)調(diào)快速、精確與自動時序、功耗與SI收斂，提高了Encounter的低功耗性能。它解決了層次模塊分割、物理時序優(yōu)化、3-D RC提取、電壓降、泄漏和動態(tài)功耗優(yōu)化、信號干擾故障和延遲分析等問題。該流程讓設(shè)計(jì)師可以用系統(tǒng)性的、可預(yù)測的方式進(jìn)行設(shè)計(jì)和優(yōu)化，得到最高質(zhì)量的芯片。
“我們很高興與SMIC合作推出基于90納米工藝技術(shù)的參考設(shè)計(jì)流程。”Cadence產(chǎn)業(yè)聯(lián)盟業(yè)務(wù)發(fā)展部副總裁Mike McAweeney說。“我們與SMIC的合作讓我們的客戶在設(shè)計(jì)鏈上又有了一個重要的關(guān)聯(lián)，保證了從概念到投片的整個設(shè)計(jì)鏈的可制造性考量。它照顧了中國越來越多的制造廠和設(shè)計(jì)公司的需求，而他們一直依賴于Cadence的數(shù)字IC設(shè)計(jì)流程。”
SMIC-Cadence低功耗數(shù)字設(shè)計(jì)參考流程是創(chuàng)造次130納米的節(jié)能系統(tǒng)級芯片的起點(diǎn)。該流程融合了Cadence的多種獨(dú)創(chuàng)技術(shù)，包括優(yōu)化功耗的設(shè)計(jì)流程、Encounter時序系統(tǒng)、Encounter RTL編譯器全局優(yōu)化、Encounter低功耗系統(tǒng)級芯片參考設(shè)計(jì)流程、Cadence提取技術(shù)、搭配PowerMeter功能的VoltageStorm® 功耗分析以及CeltIC® 納米延時計(jì)算器（NDC），使用高度精確的有效電流源延時模型（ECSM），降低了低功耗消費(fèi)應(yīng)用電子產(chǎn)品的擴(kuò)產(chǎn)時間。
該設(shè)計(jì)參考流程結(jié)合了Cadence Encounter數(shù)字IC設(shè)計(jì)平臺和Cadence可制造性設(shè)計(jì)(DFM）技術(shù)，攻克了低功耗、復(fù)雜的層次設(shè)計(jì)、時序及信號集成（SI）簽收等納米設(shè)計(jì)的挑戰(zhàn)。該設(shè)計(jì)參考流程使用SMIC的90納米工藝技術(shù)進(jìn)行開發(fā)，通過了樣品設(shè)計(jì)驗(yàn)證。Cadence作為最早與SMIC合作的電子設(shè)計(jì)自動化公司之一，與SMIC一起推出了90納米Encounter低功耗系統(tǒng)級芯片設(shè)計(jì)參考流程。Cadence的新技術(shù)如Encounter時序系統(tǒng)已結(jié)合到該流程中，用于靜態(tài)時序分析（STA）簽收。
“與Cadence的合作幫助我們達(dá)成繼續(xù)推動中國和全球半導(dǎo)體市場發(fā)展的目標(biāo)。”SMIC設(shè)計(jì)服務(wù)部副總裁歐陽雄說，“作為復(fù)雜低功耗及數(shù)字設(shè)計(jì)解決方案的領(lǐng)導(dǎo)者，Cadence提供了獨(dú)特的技術(shù)與專業(yè)知識，設(shè)計(jì)了這一參考設(shè)計(jì)流程。這一90納米SMIC低功耗參考設(shè)計(jì)流程，有Encounter時序系統(tǒng)及其它來自Cadence的尖端數(shù)字IC設(shè)計(jì)技術(shù)推動，加上SMIC的工藝技術(shù)，將確保我們的客戶獲得極高的質(zhì)量和生產(chǎn)力，并提供了更快、更有效、風(fēng)險更低的投片方式。”
這套“SMIC-Cadence設(shè)計(jì)參考流程”是一套完整的Encounter低功耗系統(tǒng)級芯片設(shè)計(jì)參考流程，其重點(diǎn)在于90納米系統(tǒng)級芯片（SoC）的高效能源利用。它對功耗問題的優(yōu)化貫穿了所有必要的設(shè)計(jì)步驟，包括邏輯綜合、模擬、測試設(shè)計(jì)、等價性檢驗(yàn)、芯片虛擬原型、物理實(shí)現(xiàn)和完成簽收分析。Encounter低功耗流程是業(yè)界首個為現(xiàn)代系統(tǒng)級芯片節(jié)能需求而設(shè)計(jì)的完整的低功耗解決方案之一。設(shè)計(jì)、實(shí)現(xiàn)和驗(yàn)證技術(shù)完整結(jié)合，讓設(shè)計(jì)師的工作效率大大提升。該設(shè)計(jì)參考流程采用了Cadence Encounter以連線為首要考量的連續(xù)收斂方法，讓設(shè)計(jì)師可以迅速得到可行的網(wǎng)表和虛擬原型，在設(shè)計(jì)周期的初期就可以分析及優(yōu)化功耗、時序、SI和布線。
此外，該流程為設(shè)計(jì)師提供了一個全面的平臺，強(qiáng)調(diào)快速、精確與自動時序、功耗與SI收斂，提高了Encounter的低功耗性能。它解決了層次模塊分割、物理時序優(yōu)化、3-D RC提取、電壓降、泄漏和動態(tài)功耗優(yōu)化、信號干擾故障和延遲分析等問題。該流程讓設(shè)計(jì)師可以用系統(tǒng)性的、可預(yù)測的方式進(jìn)行設(shè)計(jì)和優(yōu)化，得到最高質(zhì)量的芯片。
“我們很高興與SMIC合作推出基于90納米工藝技術(shù)的參考設(shè)計(jì)流程。”Cadence產(chǎn)業(yè)聯(lián)盟業(yè)務(wù)發(fā)展部副總裁Mike McAweeney說。“我們與SMIC的合作讓我們的客戶在設(shè)計(jì)鏈上又有了一個重要的關(guān)聯(lián)，保證了從概念到投片的整個設(shè)計(jì)鏈的可制造性考量。它照顧了中國越來越多的制造廠和設(shè)計(jì)公司的需求，而他們一直依賴于Cadence的數(shù)字IC設(shè)計(jì)流程。”
SMIC-Cadence低功耗數(shù)字設(shè)計(jì)參考流程是創(chuàng)造次130納米的節(jié)能系統(tǒng)級芯片的起點(diǎn)。該流程融合了Cadence的多種獨(dú)創(chuàng)技術(shù)，包括優(yōu)化功耗的設(shè)計(jì)流程、Encounter時序系統(tǒng)、Encounter RTL編譯器全局優(yōu)化、Encounter低功耗系統(tǒng)級芯片參考設(shè)計(jì)流程、Cadence提取技術(shù)、搭配PowerMeter功能的VoltageStorm® 功耗分析以及CeltIC® 納米延時計(jì)算器（NDC），使用高度精確的有效電流源延時模型（ECSM），降低了低功耗消費(fèi)應(yīng)用電子產(chǎn)品的擴(kuò)產(chǎn)時間。
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本文鏈接：CADENCE與中芯國際提供90納米低
http:m.mangadaku.com/news/2006-9/20069884314.html
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